verilog compiler

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करीबन verilog compiler

जावा और जावासीसी का उपयोग करके लिखा गया एक वेरिलॉग भाषा संकलक। यह सभी सेल कनेक्शन की एक नेटलिस्ट, एक एएससीआई टेक्स्ट फाइल पैदा करता है। यह कई मॉड्यूल शामिल बहुत बड़े सर्किट संकलित कर सकते हैं।